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1. FPGA‐based active disturbance rejection velocity control for a parallel DC/DC buck converter‐DC motor system
Esteban Guerrero, Enrique Guzmán, Jesús Linares, Alberto Martínez, Gerardo Guerrero
IET Power Electronics  vol: 13  num.: 2  primera página: 356  año: 2020  
doi: 10.1049/iet-pel.2019.0832



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Universitat Politècnica de València     https://doi.org/10.4995/riai

e-ISSN: 1697-7920     ISSN: 1697-7912